LOGIQUE ARITHMETIQUE ET TECHNIQUES SYNCHRONES
Arithmétique binaire et décimale, Conception synchrone des ASICs et des FPGAs
Résumé
Ce cours présente les algorithmes fondamentaux de l'arithmétique et les méthodes les plus récentes de conception synchrone de systèmes logiques. Les algorithmes d'arithmétique binaire et décimale et les schémas associés sont présentés en première partie de l'ouvrage. L'auteur montre qu'ils constituent une base précieuse pour leur modélisation dans le langage VHDL. La seconde partie décrit les techniques de conception synchrone d'un système logique, encore peu connues, mais indispensables pour la conception d'un ASIC ou d'un FPGA. L'ensemble constitue un ouvrage de référence pour les étudiants en électronique, ainsi que les ingénieurs et les techniciens.
Sommaire
- Logique arithmétique
- Addition et soustraction binaires de nombres entiers positifs ou négatifs
- Addition et soustraction de nombres quelconques
- La multiplication
- La division
- Techniques synchrones
- La conception synchrone
- La synchronisation et ses techniques
- Le comptage dans la conception synchrone
- Matérialisation de la partie commande d'un système logique
Caractéristiques techniques
| PAPIER | |
| Éditeur(s) | Masson |
| Auteur(s) | Michel Aumiaux |
| Parution | 01/05/1996 |
| Format | 16 x 24 |
| Couverture | Broché |
| EAN13 | 9782225852275 |
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